Cadence的硅實現(xiàn)方法加快十億以上門級的設(shè)計，

實現(xiàn)28納米布線的2倍性能的優(yōu)勢

加州圣荷塞，2011年2月10日 – 全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS) ，今日宣布推出28納米的可靠數(shù)字端到端流程，推動千兆門/千兆赫系統(tǒng)級芯片（SoC）設(shè)計，在性能與上市時間方面都有著明顯的優(yōu)勢。在Cadence的硅實現(xiàn)方法的驅(qū)動下，在統(tǒng)一化設(shè)計、實現(xiàn)與驗證流程中，通過技術(shù)集成和對核心架構(gòu)與算法大幅改進，基于Encounter的全新流程提供了更快、更具決定性的途徑實現(xiàn)千兆門/千兆赫硅片。通過與Cadence的模擬/混合信號與硅/封裝協(xié)同設(shè)計領(lǐng)域的無縫綜合，新的數(shù)字28納米流程讓設(shè)計師能夠全局考慮整個芯片流程，在高性能、低功耗、混合信號甚至面向移動與多媒體SoC的3D-IC設(shè)計關(guān)鍵成功因素方面實現(xiàn)重大突破。

即將上市的這種新流程支持Cadence的硅實現(xiàn)方法，專注于獨一無二且普遍深入的設(shè)計意圖、提取與從RTL到GDSII，然后到封裝。硅實現(xiàn)是EDA360構(gòu)想的一個關(guān)鍵組成部分。

“28納米工藝技術(shù)對設(shè)計人員來說既是重大的機遇也是嚴峻的挑戰(zhàn)，在功率、性能以及尺寸方面都具有優(yōu)勢，但是也面臨工藝變化和新制造效應(yīng)的挑戰(zhàn)，”創(chuàng)意電子公司設(shè)計與開發(fā)部門主管Albert Li說，“我們采用了Cadence的數(shù)字端對端流程用于我們首個28納米設(shè)計，因為Cadence公司的提供的千兆門級/千兆赫設(shè)計能力和先進工藝節(jié)點技術(shù)正是我們公司為客戶提供服務(wù)所需要的。使用Cadence的數(shù)字端對端流程，我們公司不僅能夠處理28納米設(shè)計的復(fù)雜布局布線、多變性以及制造要求，還能夠在合理的設(shè)計周期時間內(nèi)應(yīng)對100+百萬門級的設(shè)計。較終可以提高我們公司的生產(chǎn)力并能幫助我們更好地預(yù)測服務(wù)的交付進度。”

這種新流程使高級工藝節(jié)點不用再為復(fù)雜性而妥協(xié)，可以優(yōu)化28納米的復(fù)雜設(shè)計，為高級SoC開發(fā)提供一個途徑，使其能實現(xiàn)在更小工藝尺寸下的成本優(yōu)勢。流程功能的關(guān)鍵是統(tǒng)一基于意圖、提取和聚合的數(shù)字設(shè)計、實現(xiàn)與驗證。

提升統(tǒng)一意圖的功能包括：

·          完整、可靠的28納米設(shè)計規(guī)則意圖（電學(xué)、物理、DFM）和早期的提前權(quán)衡分析，通過智能導(dǎo)孔與引腳密度優(yōu)化，提供運行時間方面的兩倍提升。

·          早期時鐘拓撲意圖捕捉和規(guī)劃使用物理信息智能優(yōu)化時鐘門控，并在設(shè)計的合成過程中平衡時鐘樹。

提高提取的功能包括：

·          突破性的數(shù)據(jù)提取技術(shù)能夠讓整個邏輯模塊被簡單而精確地建模，并在邏輯與物理方面進行優(yōu)化，提高千兆門級的可升級性與設(shè)計效率。

·          支持分層低功耗和基于OpenAccess混合信號的快速/細節(jié)提取，以保證IP和高級SoC快速集成。

更快的設(shè)計收斂通過如下功能實現(xiàn)：

·          注重物理考量的pre-mask ECO使困難的功能性ECO操作自動化，使設(shè)計收斂速度大大加快，并顯著地縮短了設(shè)計周期。

·          突破性的設(shè)計內(nèi)高級分析架構(gòu)，提供超快、一步式信號完整性與設(shè)計流程中的時序分析收斂，實現(xiàn)高效設(shè)計收斂。

·          精確的全混合信號靜態(tài)時序分析與時序驅(qū)動式優(yōu)化，減少模擬與數(shù)字設(shè)計團隊之間的反復(fù)工作。

·          全新、帶有統(tǒng)一意圖、提取和收斂、全面集成的3D-IC/功能，跨越數(shù)字、全定制與封裝設(shè)計，如今可實現(xiàn)優(yōu)化的性能、尺寸、成本與功率。

“28納米設(shè)計的復(fù)雜性以及對復(fù)雜千兆門/千兆赫設(shè)計的支持需要，都要求一種綜合的端到端流程，”Silicon Realization產(chǎn)品市場部高級經(jīng)理David Desharnais說。“我們獨一無二的硅實現(xiàn)方法讓我們的客戶推進其SoC設(shè)計到新的層次，從而為新一代的多媒體、通信與計算應(yīng)用提供功能較強的芯片。今天我們公布的28納米全面數(shù)字硅實現(xiàn)流程是朝著EDA360構(gòu)想的實現(xiàn)又邁出了一大步。”

基于Encounter的硅實現(xiàn)數(shù)字端到端流程所包含的技術(shù)有；Encounter RTL Compiler\ Encounter Digital Implementation System, Encounter Conformal 技術(shù)、, Encounter Test、 Encounter Timing System、 Cadence QRC Extraction, Encounter Power System 和 Encounter DFM技術(shù)。

關(guān)于Cadence

Cadence公司成就全球電子設(shè)計技術(shù)創(chuàng)新，并在創(chuàng)建當(dāng)今集成電路和電子產(chǎn)品中發(fā)揮核心作用。我們的客戶采用Cadence的軟件、硬件、設(shè)計方法和服務(wù)，來設(shè)計和驗證用于消費電子產(chǎn)品、網(wǎng)絡(luò)和通訊設(shè)備以及計算機系統(tǒng)中的尖端半導(dǎo)體器件、印刷電路板和電子系統(tǒng)。公司總部位于美國加州圣荷塞市，在世界各地均設(shè)有銷售辦事處、設(shè)計中心和研究設(shè)施，以服務(wù)于全球電子產(chǎn)業(yè)。關(guān)于公司、產(chǎn)品及服務(wù)的更多信息，敬請瀏覽公司網(wǎng)站 www.cadence.com。